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如何处理SWAP后回注至原理图时,封装引脚顺序被打乱的问题?

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admin 发表于 2012-9-7 22:54:12 | 显示全部楼层 |阅读模式

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FPGA、连接器等在Allegro中使用Swap功能后回注到原理图中去,可以看见网络位置未改变,更换的是原理图中对应的元件封装中的各引脚位置,即原理图封装被修改了。
而我现在想问的是,如AD这类软件都支持在SWAP后更新原理图时可以选择更新网络位置或原理图封装引脚位置,为何Cadence没有这个功能~
或者是我没有发现?

烦请各位赐教
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